凱為科技 Kaviaz Technology
工程師站在全息 SoC 方塊圖與涵蓋率儀表板前,圖中路徑正自動生成測試情境
EDA 解決方案

Breker

自動化的系統級測試合成,專攻難以觸及的邊角案例

  • PSS
  • Test Synthesis
  • SystemVIP
  • RISC-V
  • Arm
  • Coherency

Breker Systems 專注於以 AI 驅動的測試生成技術進行 SoC/IP 驗證——直接從情境模型自動合成測試,取代手寫 testbench,目標鎖定多核心 SoC、RISC-V 與 Arm 架構的驗證需求,產生的測試可在整個驗證流程中重複使用,從模擬、模擬加速到 FPGA 原型與矽上都能沿用同一套情境。

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產品與功能

Breker 產品線

測試合成

Test Suite Synthesis

產品家族涵蓋 TrekUVM、TrekSoC 與 TrekSoC-Si,以 Accellera Portable Stimulus Standard(PSS)為基礎。TrekUVM 自動產生 UVM 測試案例、降低手寫序列的複雜度;TrekSoC 建立驗證情境模型並自動產生含刺激、預期結果與覆蓋率的 SoC 測試,TrekSoC-Si 則專攻矽後驗證。

  • 以 PSS 為基礎,測試可跨模擬、模擬加速、FPGA 原型與矽上重複使用
  • 可與 SystemVIP 搭配取得專門的驗證內容,並提供除錯與覆蓋率分析
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系統級 VIP

SystemVIP

業界領先的 SystemVIP 元件庫,運用 AI Planning Algorithm 探索狀態空間並合成高覆蓋率測試,可對多維度情境進行交叉組合(例如將權限層級與分支預測情境交叉),並支援跨執行緒/多核心的並行排程對 SoC 資源施壓。

  • System Coherency:驗證多處理器 SoC 的快取與系統級一致性
  • Arm & RISC-V SoC:涵蓋 CoreAssurance、SoCReady 等針對典型錯誤來源的系列測試
  • 涵蓋硬體安全(Security HRoT)與電源管理(Power Management)等系統層級驗證情境
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